Le LP de LPDDR6 signifie Low Power. Cette nouvelle norme vient donc remplacer la LPDDR5 avec plus de débits et moins de consommation. Les fabricants de mémoire n’ont, comme toujours, pas attendu le JEDEC (organisme en charge de développer la mémoire) pour annoncer des produits.
Le JEDEC explique que la « LPDDR6 utilise une architecture avec deux sous-canaux [12 bits chacun, ndlr] qui permet un fonctionnement flexible ». L’organisme promet aussi « une tension et une consommation d'énergie plus faibles » par rapport à la LPDDR5.
Il est question d’une vitesse de 10,667 Gb/s pour commencer, avec 14,4 Gb/s en embuscade. C’est du moins ce qu’indique ce document du JEDEC mis en ligne l’année dernière. Il y a de nombreux autres détails techniques.
Commentaires (8)
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Abonnez-vousLe 10/07/2025 à 09h07
Modifié le 10/07/2025 à 09h21
Ca veut dire quoi RAS dans le contexte ?
Est-ce que ça à avoir avec ça :
[...]RAS, standing for row address strobe[...]
https://www.lenovo.com/us/en/glossary/what-is-ras/?orgRef=https%253A%252F%252Fwww.google.com%252F
ou ça :
Reliability, Availability, and Serviceability (RAS)
PS : Comme c'est en anglais, je pense que ce n'est pas Rien A Signaler.
Je penserai pour le second vu le bouclier de captain. Mais dans le doute je pose la question.
Le 10/07/2025 à 09h50
Le 10/07/2025 à 10h55
Le 10/07/2025 à 10h56
Le 10/07/2025 à 11h04
Le 11/07/2025 à 13h55
C’est d’ailleurs pour ça qu’ils parlent de metadata et link protection. PRAC signifie par ailleurs Per-Row Activation Counting et JEDEC le définit comme suit :
“JESD79-5C introduces an innovative solution to improve DRAM data integrity called Per-Row Activation Counting (PRAC). PRAC precisely counts DRAM activations on a wordline granularity. When PRAC-enabled DRAM detects an excessive number of activations, it alerts the system to pause traffic and to designate time for mitigative measures. These interrelated actions underpin PRAC's ability to provide a fundamentally accurate and predictable approach for addressing data integrity challenges through close coordination between the DRAM and the system.”
https://www.jedec.org/news/pressreleases/jedec-updates-jesd79-5c-ddr5-sdram-standard-elevating-performance-and-security
Le 11/07/2025 à 15h38
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